（全球TMT2021年6月10日讯）新思科技（Synopsys, Inc.）近日宣布推出全新的DesignWare® Die-to-Die控制器IP核，与公司现有的112G USR/XSR PHY IP核共同实现完整的die-to-die IP解决方案。该完整的IP解决方案可为开发者提供低延迟、高带宽的die-to-die连接，以满足高性能计算、人工智能（AI）和网络SoC对更大工作量和更快速数据传送的需求。DesignWare Die-to-Die控制器和PHY IP核是新思科技多裸晶芯片解决方案的一部分，由HBM IP和3DIC Compiler组成，可加速需要先进封装的SoC设计。

DesignWare Die-to-Die控制器具有错误校正机制，如可选的前向错误校正和循环冗余校验，以实现更高的数据完整性和链路可靠性。DesignWare Die-to-Die控制器的灵活配置支持AMBA® CXS和AXI协议，可实现相干和非相干的数据通信，从而轻松集成到基于Arm的SoC和其他高性能SoC中。DesignWare Die-to-Die控制器支持高达1.8Tb/s PHY带宽，可实现强大的die-to-die连接以满足SoC对高性能计算的需求。

新思科技广泛的DesignWare IP核组合包括逻辑库、嵌入式存储器、IO、PVT监视器、嵌入式测试、模拟IP、接口IP、安全IP、嵌入式处理器和子系统。为加速原型设计、软件开发以及将IP核整合进芯片，新思科技IP Accelerated计划提供IP原型设计套件、IP软件开发套件和IP核子系统。我们对IP质量的广泛投资、全面的技术支持可使设计人员降低整合风险，并加快上市时间。